設(shè)計異步多時鐘系統(tǒng)的綜合以及描述技巧  文件大�。�183 授權(quán)方式：免費 軟件類別：資料 軟件語言：簡體中文 運行環(huán)境：Win9x/Me/NT/2000 所需點數(shù)：機電之家  E-mail 相關(guān)鏈接：開發(fā)商主頁  程序演示 更新時間：2009-4-28 10:01:00 解壓密碼： 推薦等級： 下載次數(shù)：

下載地址

下載地址1

本資料下載需扣點數(shù)：0點, 扣金錢數(shù)：0元
相關(guān)軟件

• FPGA原型設(shè)計－－軟件最重要！(5)
• 基于LM35溫度傳感器的溫控系統(tǒng)設(shè)計(12)
• 70_華碩內(nèi)部的PCB設(shè)計規(guī)范(26)
• 54_《振蕩電路的設(shè)計與應(yīng)用》(5648)
• 196_手把手教您 Verilog HDL硬件描述語言(3046)

軟件簡介

設(shè)計異步多時鐘系統(tǒng)的綜合以及描述技巧

Synthesis and Scripting Techniques for Designing Multi-
Asynchronous Clock Designs

ABSTRACT
Designing a pure, one-clock synchronous design is a luxury that few ASIC designers will ever know. Most of the
ASICs that are ever designed are driven by multiple asynchronous clocks and require special data, control-signal
and verification handling to insure the timely completion of a robust working design.
SNUG-2001
San Jose, CA
Voted Best Paper
3rd Place